キャバ嬢写メ日記集
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【ADC】デジタルオーディオ自作総合ｽﾚｯﾄﾞ 11【DAC】
482:11/19(木) 20:27 i8qx1tvQ [sage]
>>481

要はRcは遅延なしデータ、32bit遅延データで作って
Lchは32bit遅延データと64bit遅延データで作るってことだね。

パラレルにする効果は前スレに書いてたのがこれ 省16
483:11/19(木) 20:28 D0vS1v0p [sage]
>>480
FSYNCと同期させる為じゃまいか？たぶん
半分(32bit)ズレちゃうわけだし。>>481では勝手に良いものと思ってたけど・・・
同期取る必要がないのもあったと思うけど、やっぱり不味いみたいね
484:11/19(木) 20:31 D0vS1v0p [sage]
おお、サンクスと言いたいところだけど
電圧って並列しても変わらないような・・・
485:11/19(木) 20:54 prLhmoPs [sage]
>>483

いやこのLR分離ではFSYNC側を反転させてDACに入れてるはず

自分はJinson氏の昔の回路図見てるんだけど
その回路図では74HC04で反転させたりしてるんだよね 省26
486:11/19(木) 21:19 D0vS1v0p [sage]
>>482,485
スイマセン。チラッと見たデータシート(pinのとこ)にreft,light channel voltage output
ってあったもんだから、てっきり電圧出力だと・・・失礼しました。　　￣￣￣￣￣￣￣
487:11/19(木) 21:27 D0vS1v0p [sage]
reft,light て・・・自分がここまで馬鹿とは思ってなかった・・・
でも、電圧出力でも結構パラってるのってあるみたいですし、実際効果あるみたいですね
488:11/19(木) 21:58 bKvW+XQ7 [sage]
電圧出力のパラなら保護抵抗いれないと不味いでしょ。
489:11/19(木) 22:42 ck9dXoqh [sage]
電圧出力だとFN1242とかWolfsonのチップが
電圧出力だったはずです。
WolfsonだとEmusike氏、FN1242だとFujiwara氏がパラの
基板をだしてたことがありますね。
Emisuke氏の掲示板の書き込みでは、普通にパラっても
効果はないけど、電圧加算回路を使えば電流加算と同等の 省8
490:11/19(木) 23:10 D0vS1v0p [sage]
>>489
サンクス。掲示板の方見ましたけど自分じゃまだダメそうです。(自分と同じような方もいたみたいですね)
なんというか加算回路っていうと、こっちのミキサー用途のイメージがある
ttp://www.mech.tohoku-gakuin.ac.jp/rde/contents/course/mechatronics/analog.html
ttp://www.nahitech.com/nahitafu/mame/mame3/sum.html
省9
491:11/20(金) 07:13 DLUfvkvZ [sage]
単純に信号を加算するのに、ただ並列するだけじゃ出来ないので加算回路使っただけみたいですね。
AD1852・PCM1791のデータシートだと差動合成・LPFも一緒にやってしまって若干ごちゃっとしますけど、
やってることは電流加算と同じで、結局は20log(n/√n)[dB]でS/Nが向上。たぶん。
(非反転側も同じでいいみたいですね。3パラ差動1次でLTspiceに入れただけですがLPFもOKでした)
電流加算の方が同電圧を得るのに、>>461の様により低抵抗で構成できる分有利かもしれませんが
省10
上前次1-新書写板覧設AA
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